Proyecto Quimera - Receptor SDR de banda ancha

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Proyecto Quimera - Receptor SDR de banda ancha

Notapor JackBauer » 06 Ene 2012, 03:57

Estimados compañeros, a continuación paso a describir una idea que me ronda la cabeza hace ya tiempo, pero que por motivos de falta del mismo y de conocimientos en el terreno de la programación de dispositivos FPGA, he ido retrasando sistemáticamente. El proyecto se basa en tres bloques fundamentales:

1. Front-end de RF: En una primera implementación, se puede utilizar un sintonizador de televisión para abaratar costes, aunque posteriormente quiero utilizar tecnología YIG http://f6bon.albert.free.fr/YIG.html para ampliar la cobertura hasta los 22 GHz.


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2. Conversor analógico/digital de alta velocidad: Texas Instruments ADS5474 14bit 400 MSPS con un ancho de banda de 1.4 GHz. Aunque el precio de este integrado supera los $ 300, se puede encontrar en ebay por $ 45 http://www.ebay.es/itm/170728819404?ssPageName=STRK:MEWAX:IT&_trksid=p3984.m1423.l2649 o pedir como muestra gratuita a TI (a mi me lo han enviado sin coste alguno, espero devolverles el favor si este proyecto triunfa ;) ). He elegido este chip por tres razones fundamentales:

a) Tiene unas patillas relativamente fáciles de soldar si se comparan con el Linear LTC 2208.
b) Su brutal ancho de banda, capaz de digitalizar casi directamente cualquier cosa.
c) Está disponible como muestra gratuita.

3. FPGA Xilinx Spartan XC3S500E: Como dice Pieter http://wwwhome.cs.utwente.nl/~ptdeboer/ham/sdr en su página, es el FPGA más grande de la familia Xilinx que no es BGA (con la dificultad añadida que ello implica a la hora de soldar).

Para transferir los datos al ordenador estoy dudando entre un chip GigaBit ethernet como hace Pieter o montarlo todo en una tarjeta PCI, lo cual complica un poco el asunto, ya que habría que lidiar con las señales del bus PCI.


PRIMERA APROXIMACIÓN

Antes de comenzar con el diseño del PCB, quiero experimentar con el control del ADC desde el FPGA, y esta es la parte que no domino, la programación del FPGA y para lo cual necesito vuestra ayuda.

Quiero montar un entrenador con las siguientes placas:

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Nexys 2 de Digilent: http://digilent.org/Products/Detail.cfm?Prod=NEXYS2



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AnalogDevices AD6640ST Evaluation Board: http://cgi.ebay.es/ws/eBayISAPI.dll?ViewItem&item=220636852990&_rdc=1


Necesito la ayuda de alguien que sepa programar en VHDL o Handle-C

Cualquier ayuda o sugerencia será bienvenida.

Podéis seguir el desarrollo del proyecto en http://espectrodigital.com/foro/index.php?topic=55.0

Un cordial saludo.
JackBauer
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